drivers/spi: Remove legacy DesignWare SPI driver
Nothing requires this driver anymore. Signed-off-by: Tomasz Bursztyka <tomasz.bursztyka@linux.intel.com>
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Tomasz Bursztyka
Carles Cufí
parent
6d870ae25c
commit
44d4de5105
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@ -1,5 +1,4 @@
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if(CONFIG_SPI_LEGACY_API)
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if(CONFIG_SPI_LEGACY_API)
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zephyr_sources_ifdef(CONFIG_SPI_DW spi_dw_legacy.c)
|
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||||||
zephyr_sources_ifdef(CONFIG_SPIM_NRF52 spim_nrf52_legacy.c)
|
zephyr_sources_ifdef(CONFIG_SPIM_NRF52 spim_nrf52_legacy.c)
|
||||||
zephyr_sources_ifdef(CONFIG_SPIS_NRF5 spis_nrf5_legacy.c)
|
zephyr_sources_ifdef(CONFIG_SPIS_NRF5 spis_nrf5_legacy.c)
|
||||||
zephyr_sources_ifdef(CONFIG_SPI_INTEL spi_intel.c)
|
zephyr_sources_ifdef(CONFIG_SPI_INTEL spi_intel.c)
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||||||
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||||||
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@ -26,25 +26,6 @@ struct spi_dw_config {
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spi_dw_config_t config_func;
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spi_dw_config_t config_func;
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||||||
};
|
};
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||||||
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#if defined(CONFIG_SPI_LEGACY_API)
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struct spi_dw_data {
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struct k_sem device_sync_sem;
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u32_t error:1;
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u32_t dfs:3; /* dfs in bytes: 1,2 or 4 */
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u32_t slave:17; /* up 16 slaves */
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u32_t fifo_diff:9; /* cannot be bigger than FIFO depth */
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u32_t last_tx:1;
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||||||
u32_t _unused:1;
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||||||
#ifdef CONFIG_SPI_DW_CLOCK_GATE
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||||||
struct device *clock;
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||||||
#endif /* CONFIG_SPI_DW_CLOCK_GATE */
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const u8_t *tx_buf;
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||||||
u32_t tx_buf_len;
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||||||
u8_t *rx_buf;
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||||||
u32_t rx_buf_len;
|
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||||||
};
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||||||
#else
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||||||
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||||||
#include "spi_context.h"
|
#include "spi_context.h"
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||||||
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||||||
struct spi_dw_data {
|
struct spi_dw_data {
|
||||||
|
|
@ -56,7 +37,6 @@ struct spi_dw_data {
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||||||
u8_t fifo_diff; /* cannot be bigger than FIFO depth */
|
u8_t fifo_diff; /* cannot be bigger than FIFO depth */
|
||||||
u16_t _unused;
|
u16_t _unused;
|
||||||
};
|
};
|
||||||
#endif /* CONFIG_SPI_LEGACY_API */
|
|
||||||
|
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||||||
/* Helper macros */
|
/* Helper macros */
|
||||||
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||||||
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@ -216,46 +196,6 @@ struct spi_dw_data {
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||||||
#include "spi_dw_regs.h"
|
#include "spi_dw_regs.h"
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||||||
#endif
|
#endif
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||||||
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||||||
/* GPIO used to emulate CS */
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||||||
#if defined(CONFIG_SPI_LEGACY_API)
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||||||
#ifdef CONFIG_SPI_DW_CS_GPIO
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||||||
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#include <gpio.h>
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static inline void _spi_config_cs(struct device *dev)
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{
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const struct spi_dw_config *info = dev->config->config_info;
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||||||
struct spi_dw_data *spi = dev->driver_data;
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||||||
struct device *gpio;
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||||||
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||||||
gpio = device_get_binding(info->cs_gpio_name);
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||||||
if (!gpio) {
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spi->cs_gpio_port = NULL;
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||||||
return;
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}
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||||||
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||||||
gpio_pin_configure(gpio, info->cs_gpio_pin, GPIO_DIR_OUT);
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||||||
/* Default CS line to high (idling) */
|
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||||||
gpio_pin_write(gpio, info->cs_gpio_pin, 1);
|
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||||||
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||||||
spi->cs_gpio_port = gpio;
|
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||||||
}
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||||||
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||||||
static inline void _spi_control_cs(struct device *dev, int on)
|
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||||||
{
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||||||
const struct spi_dw_config *info = dev->config->config_info;
|
|
||||||
struct spi_dw_data *spi = dev->driver_data;
|
|
||||||
|
|
||||||
if (spi->cs_gpio_port) {
|
|
||||||
gpio_pin_write(spi->cs_gpio_port, info->cs_gpio_pin, !on);
|
|
||||||
}
|
|
||||||
}
|
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||||||
#else
|
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||||||
#define _spi_control_cs(...)
|
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||||||
#define _spi_config_cs(...)
|
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||||||
#endif /* CONFIG_SPI_DW_CS_GPIO */
|
|
||||||
#endif /* CONFIG_SPI_LEGACY_API */
|
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||||||
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||||||
/* Interrupt mask
|
/* Interrupt mask
|
||||||
* SoC SPECIFIC!
|
* SoC SPECIFIC!
|
||||||
*/
|
*/
|
||||||
|
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|
||||||
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@ -1,513 +0,0 @@
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||||||
/* spi_dw.c - Designware SPI driver implementation */
|
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||||||
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||||||
/*
|
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||||||
* Copyright (c) 2015 Intel Corporation.
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||||||
*
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||||||
* SPDX-License-Identifier: Apache-2.0
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||||||
*/
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||||||
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||||||
#include <errno.h>
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||||||
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||||||
#include <kernel.h>
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#include <arch/cpu.h>
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||||||
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#include <misc/__assert.h>
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#include <board.h>
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#include <device.h>
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||||||
#include <init.h>
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||||||
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||||||
#include <sys_io.h>
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||||||
#include <clock_control.h>
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||||||
#include <misc/util.h>
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||||||
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||||||
#include <spi.h>
|
|
||||||
#include "spi_dw.h"
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#ifdef CONFIG_IOAPIC
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||||||
#include <drivers/ioapic.h>
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||||||
#endif
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||||||
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#define SYS_LOG_DOMAIN "SPI DW"
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||||||
#define SYS_LOG_LEVEL CONFIG_SYS_LOG_SPI_LEVEL
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||||||
#include <logging/sys_log.h>
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||||||
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||||||
#if (CONFIG_SYS_LOG_SPI_LEVEL == 4)
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||||||
#define DBG_COUNTER_INIT() \
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||||||
u32_t __cnt = 0
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||||||
#define DBG_COUNTER_INC() \
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||||||
(__cnt++)
|
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||||||
#define DBG_COUNTER_RESULT() \
|
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||||||
(__cnt)
|
|
||||||
#else
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||||||
#define DBG_COUNTER_INIT() {; }
|
|
||||||
#define DBG_COUNTER_INC() {; }
|
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||||||
#define DBG_COUNTER_RESULT() 0
|
|
||||||
#endif
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||||||
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||||||
static void completed(struct device *dev, int error)
|
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||||||
{
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||||||
const struct spi_dw_config *info = dev->config->config_info;
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||||||
struct spi_dw_data *spi = dev->driver_data;
|
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||||||
|
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||||||
if (error) {
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|
||||||
goto out;
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||||||
}
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||||||
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||||||
/*
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* There are several situations here.
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* 1. spi_write w rx_buf - need last_tx && rx_buf_len zero to be done.
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||||||
* 2. spi_write w/o rx_buf - only need to determine when write is done.
|
|
||||||
* 3. spi_read - need rx_buf_len zero.
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||||||
*/
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||||||
if (spi->tx_buf && spi->rx_buf) {
|
|
||||||
if (!spi->last_tx || spi->rx_buf_len) {
|
|
||||||
return;
|
|
||||||
}
|
|
||||||
} else if (spi->tx_buf) {
|
|
||||||
if (!spi->last_tx) {
|
|
||||||
return;
|
|
||||||
}
|
|
||||||
} else { /* or, spi->rx_buf!=0 */
|
|
||||||
if (spi->rx_buf_len) {
|
|
||||||
return;
|
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||||||
}
|
|
||||||
}
|
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||||||
|
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||||||
out:
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||||||
/* need to give time for FIFOs to drain before issuing more commands */
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||||||
while (test_bit_sr_busy(info->regs)) {
|
|
||||||
}
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||||||
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||||||
spi->error = error;
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||||||
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||||||
/* Disabling interrupts */
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||||||
write_imr(DW_SPI_IMR_MASK, info->regs);
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||||||
/* Disabling the controller */
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||||||
clear_bit_ssienr(info->regs);
|
|
||||||
|
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||||||
_spi_control_cs(dev, 0);
|
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||||||
|
|
||||||
SYS_LOG_DBG("SPI transaction completed %s error",
|
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||||||
error ? "with" : "without");
|
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||||||
|
|
||||||
k_sem_give(&spi->device_sync_sem);
|
|
||||||
}
|
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||||||
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||||||
static void push_data(struct device *dev)
|
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||||||
{
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||||||
const struct spi_dw_config *info = dev->config->config_info;
|
|
||||||
struct spi_dw_data *spi = dev->driver_data;
|
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||||||
u32_t data = 0;
|
|
||||||
u32_t f_tx;
|
|
||||||
DBG_COUNTER_INIT();
|
|
||||||
|
|
||||||
if (spi->rx_buf) {
|
|
||||||
f_tx = DW_SPI_FIFO_DEPTH - read_txflr(info->regs) -
|
|
||||||
read_rxflr(info->regs);
|
|
||||||
if ((int)f_tx < 0) {
|
|
||||||
f_tx = 0; /* if rx-fifo is full, hold off tx */
|
|
||||||
}
|
|
||||||
} else {
|
|
||||||
f_tx = DW_SPI_FIFO_DEPTH - read_txflr(info->regs);
|
|
||||||
}
|
|
||||||
|
|
||||||
if (f_tx && (spi->tx_buf_len == 0)) {
|
|
||||||
/* room in fifo, yet nothing to send */
|
|
||||||
spi->last_tx = 1; /* setting last_tx indicates TX is done */
|
|
||||||
}
|
|
||||||
|
|
||||||
while (f_tx) {
|
|
||||||
if (spi->tx_buf && spi->tx_buf_len > 0) {
|
|
||||||
switch (spi->dfs) {
|
|
||||||
case 1:
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|
||||||
data = UNALIGNED_GET((u8_t *)(spi->tx_buf));
|
|
||||||
break;
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||||||
case 2:
|
|
||||||
data = UNALIGNED_GET((u16_t *)(spi->tx_buf));
|
|
||||||
break;
|
|
||||||
#ifndef CONFIG_ARC
|
|
||||||
case 4:
|
|
||||||
data = UNALIGNED_GET((u32_t *)(spi->tx_buf));
|
|
||||||
break;
|
|
||||||
#endif
|
|
||||||
}
|
|
||||||
|
|
||||||
spi->tx_buf += spi->dfs;
|
|
||||||
spi->tx_buf_len--;
|
|
||||||
} else if (spi->rx_buf && spi->rx_buf_len > 0) {
|
|
||||||
/* No need to push more than necessary */
|
|
||||||
if (spi->rx_buf_len - spi->fifo_diff <= 0) {
|
|
||||||
break;
|
|
||||||
}
|
|
||||||
|
|
||||||
data = 0;
|
|
||||||
} else {
|
|
||||||
/* Nothing to push anymore */
|
|
||||||
break;
|
|
||||||
}
|
|
||||||
|
|
||||||
write_dr(data, info->regs);
|
|
||||||
f_tx--;
|
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||||||
spi->fifo_diff++;
|
|
||||||
DBG_COUNTER_INC();
|
|
||||||
}
|
|
||||||
|
|
||||||
if (spi->last_tx) {
|
|
||||||
write_txftlr(0, info->regs);
|
|
||||||
/* prevents any further interrupts demanding TX fifo fill */
|
|
||||||
}
|
|
||||||
|
|
||||||
SYS_LOG_DBG("Pushed: %d", DBG_COUNTER_RESULT());
|
|
||||||
}
|
|
||||||
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||||||
static void pull_data(struct device *dev)
|
|
||||||
{
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|
||||||
const struct spi_dw_config *info = dev->config->config_info;
|
|
||||||
struct spi_dw_data *spi = dev->driver_data;
|
|
||||||
u32_t data = 0;
|
|
||||||
DBG_COUNTER_INIT();
|
|
||||||
|
|
||||||
while (read_rxflr(info->regs)) {
|
|
||||||
data = read_dr(info->regs);
|
|
||||||
DBG_COUNTER_INC();
|
|
||||||
|
|
||||||
if (spi->rx_buf && spi->rx_buf_len > 0) {
|
|
||||||
switch (spi->dfs) {
|
|
||||||
case 1:
|
|
||||||
UNALIGNED_PUT(data, (u8_t *)spi->rx_buf);
|
|
||||||
break;
|
|
||||||
case 2:
|
|
||||||
UNALIGNED_PUT(data, (u16_t *)spi->rx_buf);
|
|
||||||
break;
|
|
||||||
#ifndef CONFIG_ARC
|
|
||||||
case 4:
|
|
||||||
UNALIGNED_PUT(data, (u32_t *)spi->rx_buf);
|
|
||||||
break;
|
|
||||||
#endif
|
|
||||||
}
|
|
||||||
|
|
||||||
spi->rx_buf += spi->dfs;
|
|
||||||
spi->rx_buf_len--;
|
|
||||||
}
|
|
||||||
|
|
||||||
spi->fifo_diff--;
|
|
||||||
}
|
|
||||||
|
|
||||||
if (!spi->rx_buf_len && spi->tx_buf_len < DW_SPI_FIFO_DEPTH) {
|
|
||||||
write_rxftlr(spi->tx_buf_len - 1, info->regs);
|
|
||||||
} else if (read_rxftlr(info->regs) >= spi->rx_buf_len) {
|
|
||||||
write_rxftlr(spi->rx_buf_len - 1, info->regs);
|
|
||||||
}
|
|
||||||
|
|
||||||
SYS_LOG_DBG("Pulled: %d", DBG_COUNTER_RESULT());
|
|
||||||
}
|
|
||||||
|
|
||||||
static inline bool _spi_dw_is_controller_ready(struct device *dev)
|
|
||||||
{
|
|
||||||
const struct spi_dw_config *info = dev->config->config_info;
|
|
||||||
|
|
||||||
if (test_bit_ssienr(info->regs) || test_bit_sr_busy(info->regs)) {
|
|
||||||
return false;
|
|
||||||
}
|
|
||||||
|
|
||||||
return true;
|
|
||||||
}
|
|
||||||
|
|
||||||
static int spi_dw_configure(struct device *dev,
|
|
||||||
struct spi_config *config)
|
|
||||||
{
|
|
||||||
const struct spi_dw_config *info = dev->config->config_info;
|
|
||||||
struct spi_dw_data *spi = dev->driver_data;
|
|
||||||
u32_t flags = config->config;
|
|
||||||
u32_t ctrlr0 = 0;
|
|
||||||
u32_t mode;
|
|
||||||
|
|
||||||
SYS_LOG_DBG("%p (0x%x), %p", dev, info->regs, config);
|
|
||||||
|
|
||||||
/* Check status */
|
|
||||||
if (!_spi_dw_is_controller_ready(dev)) {
|
|
||||||
SYS_LOG_DBG("Controller is busy");
|
|
||||||
return -EBUSY;
|
|
||||||
}
|
|
||||||
|
|
||||||
/* Word size */
|
|
||||||
ctrlr0 |= DW_SPI_CTRLR0_DFS(SPI_WORD_SIZE_GET(flags));
|
|
||||||
|
|
||||||
/* Determine how many bytes are required per-frame */
|
|
||||||
spi->dfs = SPI_WS_TO_DFS(SPI_WORD_SIZE_GET(flags));
|
|
||||||
|
|
||||||
/* SPI mode */
|
|
||||||
mode = SPI_MODE(flags);
|
|
||||||
if (mode & SPI_MODE_CPOL) {
|
|
||||||
ctrlr0 |= DW_SPI_CTRLR0_SCPOL;
|
|
||||||
}
|
|
||||||
|
|
||||||
if (mode & SPI_MODE_CPHA) {
|
|
||||||
ctrlr0 |= DW_SPI_CTRLR0_SCPH;
|
|
||||||
}
|
|
||||||
|
|
||||||
if (mode & SPI_MODE_LOOP) {
|
|
||||||
ctrlr0 |= DW_SPI_CTRLR0_SRL;
|
|
||||||
}
|
|
||||||
|
|
||||||
/* Installing the configuration */
|
|
||||||
write_ctrlr0(ctrlr0, info->regs);
|
|
||||||
|
|
||||||
/*
|
|
||||||
* Configure the rate. Use this small hack to allow the user to call
|
|
||||||
* spi_configure() with both a divider (as the driver was initially
|
|
||||||
* written) and a frequency (as the SPI API suggests to). The clock
|
|
||||||
* divider is a 16bit value, hence we can fairly, and safely, assume
|
|
||||||
* that everything above this value is a frequency. The trade-off is
|
|
||||||
* that if one wants to use a bus frequency of 64kHz (or less), it has
|
|
||||||
* the use a divider...
|
|
||||||
*/
|
|
||||||
if (config->max_sys_freq > 0xffff) {
|
|
||||||
write_baudr(SPI_DW_CLK_DIVIDER(config->max_sys_freq),
|
|
||||||
info->regs);
|
|
||||||
} else {
|
|
||||||
write_baudr(config->max_sys_freq, info->regs);
|
|
||||||
}
|
|
||||||
|
|
||||||
return 0;
|
|
||||||
}
|
|
||||||
|
|
||||||
static int spi_dw_slave_select(struct device *dev, u32_t slave)
|
|
||||||
{
|
|
||||||
struct spi_dw_data *spi = dev->driver_data;
|
|
||||||
|
|
||||||
SYS_LOG_DBG("%p %d", dev, slave);
|
|
||||||
|
|
||||||
if (slave == 0 || slave > 16) {
|
|
||||||
return -EINVAL;
|
|
||||||
}
|
|
||||||
|
|
||||||
spi->slave = 1 << (slave - 1);
|
|
||||||
|
|
||||||
return 0;
|
|
||||||
}
|
|
||||||
|
|
||||||
static int spi_dw_transceive(struct device *dev,
|
|
||||||
const void *tx_buf, u32_t tx_buf_len,
|
|
||||||
void *rx_buf, u32_t rx_buf_len)
|
|
||||||
{
|
|
||||||
const struct spi_dw_config *info = dev->config->config_info;
|
|
||||||
struct spi_dw_data *spi = dev->driver_data;
|
|
||||||
u32_t rx_thsld = DW_SPI_RXFTLR_DFLT;
|
|
||||||
u32_t imask;
|
|
||||||
|
|
||||||
SYS_LOG_DBG("%p, %p, %u, %p, %u",
|
|
||||||
dev, tx_buf, tx_buf_len, rx_buf, rx_buf_len);
|
|
||||||
|
|
||||||
/* Check status */
|
|
||||||
if (!_spi_dw_is_controller_ready(dev)) {
|
|
||||||
SYS_LOG_DBG("Controller is busy");
|
|
||||||
return -EBUSY;
|
|
||||||
}
|
|
||||||
|
|
||||||
/* Set buffers info */
|
|
||||||
spi->tx_buf = tx_buf;
|
|
||||||
spi->tx_buf_len = tx_buf_len/spi->dfs;
|
|
||||||
spi->rx_buf = rx_buf;
|
|
||||||
if (rx_buf) {
|
|
||||||
spi->rx_buf_len = rx_buf_len/spi->dfs;
|
|
||||||
} else {
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spi->rx_buf_len = 0; /* must be zero if no buffer */
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||||||
}
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||||||
spi->fifo_diff = 0;
|
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||||||
spi->last_tx = 0;
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||||||
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||||||
/* Tx Threshold */
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||||||
write_txftlr(DW_SPI_TXFTLR_DFLT, info->regs);
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||||||
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||||||
/* Does Rx thresholds needs to be lower? */
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||||||
if (spi->rx_buf_len && spi->rx_buf_len < DW_SPI_FIFO_DEPTH) {
|
|
||||||
rx_thsld = spi->rx_buf_len - 1;
|
|
||||||
} else if (!spi->rx_buf_len && spi->tx_buf_len < DW_SPI_FIFO_DEPTH) {
|
|
||||||
rx_thsld = spi->tx_buf_len - 1;
|
|
||||||
/* TODO: why? */
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||||||
}
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||||||
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||||||
write_rxftlr(rx_thsld, info->regs);
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||||||
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||||||
/* Slave select */
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||||||
write_ser(spi->slave, info->regs);
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||||||
_spi_control_cs(dev, 1);
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||||||
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||||||
/* Enable interrupts */
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imask = DW_SPI_IMR_UNMASK;
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||||||
if (!rx_buf) {
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||||||
/* if there is no rx buffer, keep all rx interrupts masked */
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||||||
imask &= DW_SPI_IMR_MASK_RX;
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||||||
}
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||||||
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||||||
write_imr(imask, info->regs);
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||||||
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||||||
/* Enable the controller */
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||||||
set_bit_ssienr(info->regs);
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||||||
k_sem_take(&spi->device_sync_sem, K_FOREVER);
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||||||
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||||||
if (spi->error) {
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spi->error = 0;
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return -EIO;
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}
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||||||
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return 0;
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}
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void spi_dw_isr(void *arg)
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{
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struct device *dev = (struct device *)arg;
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const struct spi_dw_config *info = dev->config->config_info;
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u32_t error = 0;
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u32_t int_status;
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int_status = read_isr(info->regs);
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SYS_LOG_DBG("SPI int_status 0x%x - (tx: %d, rx: %d)",
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int_status, read_txflr(info->regs), read_rxflr(info->regs));
|
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||||||
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||||||
if (int_status & DW_SPI_ISR_ERRORS_MASK) {
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error = 1;
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goto out;
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||||||
}
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||||||
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||||||
if (int_status & DW_SPI_ISR_RXFIS) {
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|
||||||
pull_data(dev);
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}
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||||||
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||||||
if (int_status & DW_SPI_ISR_TXEIS) {
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||||||
push_data(dev);
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}
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||||||
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||||||
out:
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clear_interrupts(info->regs);
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||||||
completed(dev, error);
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}
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||||||
static const struct spi_driver_api dw_spi_api = {
|
|
||||||
.configure = spi_dw_configure,
|
|
||||||
.slave_select = spi_dw_slave_select,
|
|
||||||
.transceive = spi_dw_transceive,
|
|
||||||
};
|
|
||||||
|
|
||||||
int spi_dw_init(struct device *dev)
|
|
||||||
{
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||||||
const struct spi_dw_config *info = dev->config->config_info;
|
|
||||||
struct spi_dw_data *spi = dev->driver_data;
|
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||||||
|
|
||||||
_clock_config(dev);
|
|
||||||
_clock_on(dev);
|
|
||||||
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||||||
info->config_func();
|
|
||||||
|
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||||||
k_sem_init(&spi->device_sync_sem, 0, UINT_MAX);
|
|
||||||
|
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||||||
_spi_config_cs(dev);
|
|
||||||
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||||||
/* Masking interrupt and making sure controller is disabled */
|
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||||||
write_imr(DW_SPI_IMR_MASK, info->regs);
|
|
||||||
clear_bit_ssienr(info->regs);
|
|
||||||
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||||||
SYS_LOG_DBG("Designware SPI driver initialized on device: %p", dev);
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||||||
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||||||
return 0;
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||||||
}
|
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||||||
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||||||
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||||||
#ifdef CONFIG_SPI_0
|
|
||||||
void spi_config_0_irq(void);
|
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||||||
|
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||||||
struct spi_dw_data spi_dw_data_port_0;
|
|
||||||
|
|
||||||
const struct spi_dw_config spi_dw_config_0 = {
|
|
||||||
.regs = SPI_DW_PORT_0_REGS,
|
|
||||||
#ifdef CONFIG_SPI_DW_CLOCK_GATE
|
|
||||||
.clock_data = UINT_TO_POINTER(CONFIG_SPI_0_CLOCK_GATE_SUBSYS),
|
|
||||||
#endif /* CONFIG_SPI_DW_CLOCK_GATE */
|
|
||||||
#ifdef CONFIG_SPI_DW_CS_GPIO
|
|
||||||
.cs_gpio_name = CONFIG_SPI_0_CS_GPIO_PORT,
|
|
||||||
.cs_gpio_pin = CONFIG_SPI_0_CS_GPIO_PIN,
|
|
||||||
#endif
|
|
||||||
.config_func = spi_config_0_irq
|
|
||||||
};
|
|
||||||
|
|
||||||
DEVICE_AND_API_INIT(spi_dw_port_0, CONFIG_SPI_0_NAME, spi_dw_init,
|
|
||||||
&spi_dw_data_port_0, &spi_dw_config_0,
|
|
||||||
POST_KERNEL, CONFIG_SPI_INIT_PRIORITY,
|
|
||||||
&dw_spi_api);
|
|
||||||
|
|
||||||
void spi_config_0_irq(void)
|
|
||||||
{
|
|
||||||
#ifdef CONFIG_SPI_DW_INTERRUPT_SINGLE_LINE
|
|
||||||
IRQ_CONNECT(SPI_DW_PORT_0_IRQ, CONFIG_SPI_0_IRQ_PRI,
|
|
||||||
spi_dw_isr, DEVICE_GET(spi_dw_port_0), SPI_DW_IRQ_FLAGS);
|
|
||||||
irq_enable(SPI_DW_PORT_0_IRQ);
|
|
||||||
_spi_int_unmask(SPI_DW_PORT_0_INT_MASK);
|
|
||||||
#else /* SPI_DW_INTERRUPT_SEPARATED_LINES */
|
|
||||||
IRQ_CONNECT(IRQ_SPI0_RX_AVAIL, CONFIG_SPI_0_IRQ_PRI,
|
|
||||||
spi_dw_isr, DEVICE_GET(spi_dw_port_0), SPI_DW_IRQ_FLAGS);
|
|
||||||
IRQ_CONNECT(IRQ_SPI0_TX_REQ, CONFIG_SPI_0_IRQ_PRI,
|
|
||||||
spi_dw_isr, DEVICE_GET(spi_dw_port_0), SPI_DW_IRQ_FLAGS);
|
|
||||||
IRQ_CONNECT(IRQ_SPI0_ERR_INT, CONFIG_SPI_0_IRQ_PRI,
|
|
||||||
spi_dw_isr, DEVICE_GET(spi_dw_port_0), SPI_DW_IRQ_FLAGS);
|
|
||||||
|
|
||||||
irq_enable(IRQ_SPI0_RX_AVAIL);
|
|
||||||
irq_enable(IRQ_SPI0_TX_REQ);
|
|
||||||
irq_enable(IRQ_SPI0_ERR_INT);
|
|
||||||
|
|
||||||
_spi_int_unmask(SPI_DW_PORT_0_RX_INT_MASK);
|
|
||||||
_spi_int_unmask(SPI_DW_PORT_0_TX_INT_MASK);
|
|
||||||
_spi_int_unmask(SPI_DW_PORT_0_ERROR_INT_MASK);
|
|
||||||
#endif
|
|
||||||
}
|
|
||||||
#endif /* CONFIG_SPI_0 */
|
|
||||||
#ifdef CONFIG_SPI_1
|
|
||||||
void spi_config_1_irq(void);
|
|
||||||
|
|
||||||
struct spi_dw_data spi_dw_data_port_1;
|
|
||||||
|
|
||||||
static const struct spi_dw_config spi_dw_config_1 = {
|
|
||||||
.regs = SPI_DW_PORT_1_REGS,
|
|
||||||
#ifdef CONFIG_SPI_DW_CLOCK_GATE
|
|
||||||
.clock_data = UINT_TO_POINTER(CONFIG_SPI_1_CLOCK_GATE_SUBSYS),
|
|
||||||
#endif /* CONFIG_SPI_DW_CLOCK_GATE */
|
|
||||||
#ifdef CONFIG_SPI_DW_CS_GPIO
|
|
||||||
.cs_gpio_name = CONFIG_SPI_1_CS_GPIO_PORT,
|
|
||||||
.cs_gpio_pin = CONFIG_SPI_1_CS_GPIO_PIN,
|
|
||||||
#endif
|
|
||||||
.config_func = spi_config_1_irq
|
|
||||||
};
|
|
||||||
|
|
||||||
DEVICE_AND_API_INIT(spi_dw_port_1, CONFIG_SPI_1_NAME, spi_dw_init,
|
|
||||||
&spi_dw_data_port_1, &spi_dw_config_1,
|
|
||||||
POST_KERNEL, CONFIG_SPI_INIT_PRIORITY,
|
|
||||||
&dw_spi_api);
|
|
||||||
|
|
||||||
void spi_config_1_irq(void)
|
|
||||||
{
|
|
||||||
#ifdef CONFIG_SPI_DW_INTERRUPT_SINGLE_LINE
|
|
||||||
IRQ_CONNECT(SPI_DW_PORT_1_IRQ, CONFIG_SPI_1_IRQ_PRI,
|
|
||||||
spi_dw_isr, DEVICE_GET(spi_dw_port_1), SPI_DW_IRQ_FLAGS);
|
|
||||||
irq_enable(SPI_DW_PORT_1_IRQ);
|
|
||||||
_spi_int_unmask(SPI_DW_PORT_1_INT_MASK);
|
|
||||||
#else /* SPI_DW_INTERRUPT_SEPARATED_LINES */
|
|
||||||
IRQ_CONNECT(IRQ_SPI1_RX_AVAIL, CONFIG_SPI_1_IRQ_PRI,
|
|
||||||
spi_dw_isr, DEVICE_GET(spi_dw_port_1), SPI_DW_IRQ_FLAGS);
|
|
||||||
IRQ_CONNECT(IRQ_SPI1_TX_REQ, CONFIG_SPI_1_IRQ_PRI,
|
|
||||||
spi_dw_isr, DEVICE_GET(spi_dw_port_1), SPI_DW_IRQ_FLAGS);
|
|
||||||
IRQ_CONNECT(IRQ_SPI1_ERR_INT, CONFIG_SPI_1_IRQ_PRI,
|
|
||||||
spi_dw_isr, DEVICE_GET(spi_dw_port_1), SPI_DW_IRQ_FLAGS);
|
|
||||||
|
|
||||||
irq_enable(IRQ_SPI1_RX_AVAIL);
|
|
||||||
irq_enable(IRQ_SPI1_TX_REQ);
|
|
||||||
irq_enable(IRQ_SPI1_ERR_INT);
|
|
||||||
|
|
||||||
_spi_int_unmask(SPI_DW_PORT_1_RX_INT_MASK);
|
|
||||||
_spi_int_unmask(SPI_DW_PORT_1_TX_INT_MASK);
|
|
||||||
_spi_int_unmask(SPI_DW_PORT_1_ERROR_INT_MASK);
|
|
||||||
#endif
|
|
||||||
}
|
|
||||||
#endif /* CONFIG_SPI_1 */
|
|
||||||
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